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FPGA + ISP 专业向
专注 FPGA 与 ISP 图像算法两大领域:状态机编辑、时序分析、CDC/FIFO、SDC 约束,以及完整 ISP 算子链。
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热门工具
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状态机编辑器
可视化 Moore 状态机编辑 + .fsm.json 序列化
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算子链
自定义算子顺序,实时预览叠加效果
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Verilog 代码模板库
可综合 RTL 直接复用,取自 GitHub 开源项目的已验证代码模板
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空间降噪
空域降噪三方法对照:中值去椒盐、高斯平滑、双边保边降噪
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时序图绘制器
基于 WaveDrom 语法的在线数字时序图工具,支持 SPI/I2C/UART 模板,实时 SVG 渲染与导出
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AI-Verilog 提示词工作台
聚合开源母本最佳实践,生成结构化 Verilog 提示词
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3D LUT 调色
3D LUT 查表式调色——三线性插值实现电影/相机色彩风格映射
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BOM 管理
CSV 物料清单导入/导出、行编辑、总价估算